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    首頁產(chǎn)品索引AD9516-2

    AD9516-2

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    14路輸出時(shí)鐘發(fā)生器，集成2.2 GHz VCO

    制造商：ADI/AD

    中文數(shù)據(jù)手冊

    產(chǎn)品信息

    優(yōu)勢和特點(diǎn)

      低相位噪聲鎖相環(huán)(PLL)-- 片內(nèi)VCO調(diào)諧范圍：2.05 GHz至2.33 GHz-- 可選外部VCO/VCXO，最高達(dá)2.4 GHz-- 1路差分或2路單端基準(zhǔn)輸入

      6對1.6 GHz LVPECL輸出-- 每對輸出共用1至32分頻器和粗調(diào)相位延遲-- 加性輸出抖動： 225 fs rms-- 通道間偏斜成對輸出小于10 ps

      低相位噪聲鎖相環(huán)(PLL)-- 片內(nèi)VCO的調(diào)諧頻率范圍為2.30 GHz至2.65 GHz-- 可選外部VCO/VCXO，最高達(dá)2.4 GHz-- 1路差分或2路單端參考輸入 – 參考監(jiān)控功能

      6對1.6 GHz LVPECL輸出-- 每對輸出共用1至32分頻器和粗調(diào)相位延遲-- 加性輸出抖動: 225 fs均方根值-- 通道間偏斜成對輸出小于10ps

      4對800 MHz LVDS時(shí)鐘輸出 -- 每對輸出共用兩個級聯(lián)1至32分頻器和粗調(diào)相位延遲-- 加性輸出抖動: 275 fs rms

      上電時(shí)所有輸出自動同步

      提供手動輸出同步

      64引腳LFCSP

      其他特性請參考數(shù)據(jù)手冊

    產(chǎn)品詳情

    AD9516-2*提供多路輸出時(shí)鐘分配功能，具有亞皮秒級抖動性能，并且片內(nèi)集成鎖相環(huán)(PLL)和電壓控制振蕩器(VCO)。片內(nèi)VCO的調(diào)諧頻率范圍為2.05 GHz至2.33 GHz。也可以使用最高2.4 GHz的外部VCO/VCXO。

    AD9516-2具有出色的低抖動和相位噪聲特性，可極大地提升數(shù)據(jù)轉(zhuǎn)換器的性能，并且也有利于其它相位噪聲和抖動要求嚴(yán)苛的應(yīng)用。

    AD9516-2提供6路LVPECL輸出（分為三對）、4路LVDS輸出（分為兩對）和8路CMOS輸出（每路LVDS輸出對應(yīng)兩路）。LVPECL輸出的工作頻率達(dá)1.6 GHz，LVDS輸出的工作頻率達(dá)800 MHz，CMOS輸出的工作頻率達(dá)250 MHz。

    每對輸出均有分頻器，其分頻比和粗調(diào)延遲（或相位）均可以設(shè)置。LVPECL輸出的分頻范圍為1至32。LVDS/CMOS輸出的分頻范圍最高可達(dá)1024。

    AD9516-2提供64引腳LFCSP封裝，可以采用3.3 V單電源供電。將電荷泵電源（VCP）與5 V電壓相連時(shí)，可以使用外部VCO，它需要更寬的電壓范圍。獨(dú)立的LVPECL電源可以為2.5 V至3.3 V（標(biāo)稱值）。

    AD9516-2的額定工作溫度范圍為?40°C至+85°C標(biāo)準(zhǔn)工業(yè)溫度范圍。

    應(yīng)用

      低抖動、低相位噪聲時(shí)鐘分配

      10/40/100 Gb/s網(wǎng)絡(luò)線路卡，包括SONET、同步以太網(wǎng)、OTU2/3/4

      前向糾錯(G.710)

      為高速ADC、DAC、DDS、DDC、DUC、MxFE提供時(shí)鐘

      高性能無線收發(fā)器

      自動測試設(shè)備(ATE)和高性能儀器儀表

    * AD9516泛指AD9516系列的所有器件。但是，使用AD9516-2時(shí)，它僅指AD9516系列的該特定器件。

    電路圖、引腳圖和封裝圖

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    AD9516-2BCPZ-REEL7-- 立即購買
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    技術(shù)資料

    標(biāo)題類型大小（KB）下載
    AN-835: Understanding High Speed ADC Testing and Evaluation (Rev. B)PDF1423 點(diǎn)擊下載
    AN-501: Aperture Uncertainty and ADC System Performance (Rev. A)PDF227 點(diǎn)擊下載
    AN-0983: Introduction to Zero-Delay Clock Timing TechniquesPDF162 點(diǎn)擊下載
    AN-756: Sampled Systems and the Effects of Clock Phase Noise and Jitter (Rev. 0)PDF291 點(diǎn)擊下載
    AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev. 0)PDF130 點(diǎn)擊下載
    AN-939: Super-Nyquist Operation of the AD9912 Yields a High RF Output Signal (Rev. 0)PDF221 點(diǎn)擊下載
    AN-837: DDS-Based Clock Jitter Performance vs. DAC Reconstruction Filter Performance (Rev. 0)PDF313 點(diǎn)擊下載
    AN-823: Direct Digital Synthesizers in Clocking Applications Time (Rev. 0)PDF115 點(diǎn)擊下載

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