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    AD9866

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    12位寬帶調(diào)制解調(diào)器混合信號前端(MxFE?)

    制造商:ADI/AD

    中文數(shù)據(jù)手冊

    產(chǎn)品信息

    優(yōu)勢和特點

      低成本3.3 V CMOS MxFETM,適合寬帶調(diào)制解調(diào)器

      12位數(shù)模轉(zhuǎn)換器 2×/4×插值濾波器 200 MSPS DAC更新速率

      集成23 dBm線路驅(qū)動器,具有19.5 dB增益控制范圍

      12位、80 MSPS模數(shù)轉(zhuǎn)換器

      -12 dB至+48 dB低噪聲RxPGA(<2.5 nV/√Hz)

      三階可編程低通濾波器

      靈活的數(shù)字?jǐn)?shù)據(jù)路徑接口 -半雙工和全雙工操作-向后兼容AD9975和AD9876

      多種關(guān)斷/省電模式

      內(nèi)部時鐘乘法器(PLL)

      兩路輔助可編程時鐘輸出

      提供64引腳芯片級封裝或裸片

    產(chǎn)品詳情

    AD9866是一款混合信號前端(MxFE?) IC,適合要求發(fā)射和接收路徑功能的收發(fā)器應(yīng)用,數(shù)據(jù)速率最高可達(dá)80 MSPS。靈活的數(shù)字接口、省電模式和發(fā)射-接收高隔離度,使該器件特別適合半雙工和全雙工應(yīng)用。該數(shù)字接口極為靈活,可與支持半雙工或全雙工數(shù)據(jù)傳輸?shù)臄?shù)字后端實現(xiàn)簡單接口,因此AD9866經(jīng)常用來取代分立式ADC和DAC解決方案。省電模式能夠降低個別功能模塊的功耗,或者在半雙工應(yīng)用中關(guān)斷未使用的模塊。串行端口接口(SPI)允許對許多功能模塊進(jìn)行軟件編程。片內(nèi)PLL時鐘乘法器和頻率合成器提供所有需要的內(nèi)部時鐘,以及單晶振或時鐘源的外部時鐘。

    發(fā)射信號路徑由可旁路2×/4×低通插值濾波器、12位TxDAC?和線路驅(qū)動器組成。在輸入數(shù)據(jù)速率為80 MSPS時,發(fā)射路徑信號帶寬可以高達(dá)34 MHz。TxDAC提供差分電流輸出,可將該輸出直接導(dǎo)引至外部負(fù)載,或?qū)б羶?nèi)部低失真電流放大器。電流放大器(IAMP)可以配置為電流或電壓模式線路驅(qū)動器(采用兩個外部NPN晶體管),能夠提供23 dBm以上的峰值信號功率。發(fā)射功率可以進(jìn)行數(shù)字控制,范圍為19.5 dB,步進(jìn)為0.5 dB。

    接收路徑由可編程放大器(RxPGA)、可調(diào)諧低通濾波器(LPF)和12位ADC組成。低噪聲RxPGA具有?12 dB至+48 dB的可編程增益范圍,步進(jìn)為1 dB;對于30 dB以上的增益設(shè)置,其折合到輸入端的噪聲低于3.3 nV/√Hz。接收路徑LPF截止頻率可以在15 MHz至35 MHz范圍內(nèi)設(shè)置,或者簡單地予以旁路。12位ADC可以在5 MSPS至80 MSPS范圍內(nèi)實現(xiàn)出色的動態(tài)性能。RxPGA和ADC均能提供可調(diào)整的功耗,以實現(xiàn)功耗/性能優(yōu)化。AD9866可以為許多寬帶調(diào)制解調(diào)器提供高度集成的解決方案。它采用節(jié)省空間的64引腳芯片級封裝,額定溫度范圍為?40°C至+85°C商用溫度范圍。

    應(yīng)用

      電力線網(wǎng)絡(luò)

      VDSL和HPNA

      有線通信

    電路圖、引腳圖和封裝圖

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    技術(shù)資料

    標(biāo)題類型大小(KB)下載
    AN-851: 一種WiMax雙下變頻IF采樣接收機(jī)設(shè)計方案[中文版] (Rev. 0)PDF421 點擊下載
    AN-851: A WiMax Double Downconversion IF Sampling Receiver Design (Rev. 0)PDF262 點擊下載
    AN-700: Instructions for the AD9865/AD9866 Evaluation Software (Rev. 0)PDF418 點擊下載

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