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    首頁(yè)產(chǎn)品索引AD9517-3

    AD9517-3

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    12路輸出時(shí)鐘發(fā)生器，集成2.0 GHz VCO

    制造商：ADI/AD

    中文數(shù)據(jù)手冊(cè)

    產(chǎn)品信息

    優(yōu)勢(shì)和特點(diǎn)

      低相位噪聲、鎖相環(huán)?片內(nèi)VCO的調(diào)諧頻率范圍為1.75 GHz至2.25 GHz可選外部VCO/VCXO，最高達(dá)2.4 GHz1路差分或2路單端基準(zhǔn)輸入?yún)⒖急O(jiān)控功能自動(dòng)/手動(dòng)基準(zhǔn)電壓源切換/保持模式自動(dòng)從保持狀態(tài)恢復(fù)支持最高250 MHz的LVPECL、LVDS或CMOS基準(zhǔn)可編程PFD路徑延遲可選數(shù)字或模擬時(shí)鐘檢測(cè)

      兩對(duì)1.6 GHz LVPECL輸出每對(duì)輸出共用1至32分頻器和粗調(diào)相位延遲加性輸出抖動(dòng)：225 fS 均方根值通道間偏斜成對(duì)輸出小于10 ps

      兩對(duì)800 MHz LVDS時(shí)鐘輸出每對(duì)輸出共用兩個(gè)級(jí)聯(lián)的1至32分頻器和粗調(diào)相位延遲加性輸出抖動(dòng)：275 fS 均方根值可以精調(diào)每路LVDS輸出的延遲(Δt)

      8路250 MHz CMOS輸出（每路LVDS輸出對(duì)應(yīng)兩路）

      上電時(shí)所有輸出自動(dòng)同步

      欲了解更多特性，請(qǐng)參考數(shù)據(jù)手冊(cè)

    產(chǎn)品詳情

    AD9517-31提供多路輸出時(shí)鐘分配功能，具有亞皮秒級(jí)抖動(dòng)性能，并且片內(nèi)集成鎖相環(huán)(PLL)和電壓控制振蕩器(VCO)。片內(nèi)VCO的調(diào)諧頻率范圍為1.75 GHz至2.25 GHz。也可以使用高達(dá)2.4 GHz的外部VCO/VCXO。AD9517-3具有出色的低抖動(dòng)和相位噪聲特性，可極大地提升數(shù)據(jù)轉(zhuǎn)換器的性能，并且也有利于其它相位噪聲和抖動(dòng)要求嚴(yán)苛的應(yīng)用。AD9517-3具有四路LVPECL輸出（分為兩對(duì)）和四路LVDS輸出（分為兩對(duì)）?？梢詫⒚柯稬VDS輸出重新配置為兩路CMOS輸出。LVPECL輸出的工作頻率達(dá)1.6 GHz，LVDS輸出的工作頻率達(dá)800 MHz，CMOS輸出的工作頻率達(dá)250 MHz。每對(duì)輸出均有分頻器，其分頻比和粗調(diào)延遲（或相位）均可以設(shè)置。LVPECL輸出的分頻范圍為1至32。LVDS/CMOS輸出的分頻范圍最高可達(dá)1024。AD9517-3提供48引腳LFCSP封裝，可以采用3.3 V單電源供電。采用外部VCO時(shí)，需要更寬的電壓范圍, 可通過(guò)將電荷泵電源(VCP)與5.5 V電壓相連來(lái)實(shí)現(xiàn)。獨(dú)立的LVPECL電源可以為2.5 V至3.3 V（標(biāo)稱值）。AD9517-3的額定工作溫度范圍為?40°C至+85°C標(biāo)準(zhǔn)工業(yè)溫度范圍。應(yīng)用

      低抖動(dòng)、低相位噪聲時(shí)鐘分配

      10/40/100 Gb/s網(wǎng)絡(luò)線路卡，包括SONET、同步以太網(wǎng)、OTU2/3/4

      前向糾錯(cuò)(G.710)

      為高速ADC、DAC、DDS、DDC、DUC、MxFE提供時(shí)鐘

      高性能無(wú)線收發(fā)器

      自動(dòng)測(cè)試設(shè)備(ATE)和高性能儀器儀表

    1AD9517泛指AD9517系列的所有器件。但是，使用AD9517-3時(shí)，它僅指AD9517系列的該特定器件。

    電路圖、引腳圖和封裝圖

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    型號(hào)制造商描述購(gòu)買
    AD9517-3BCPZ-REEL7-- 立即購(gòu)買
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    AD9517-3ABCPZ-RL7-- 立即購(gòu)買
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    技術(shù)資料

    標(biāo)題類型大?。↘B）下載
    AN-835: Understanding High Speed ADC Testing and Evaluation (Rev. B)PDF1423 點(diǎn)擊下載
    AN-501: Aperture Uncertainty and ADC System Performance (Rev. A)PDF227 點(diǎn)擊下載
    AN-756: Sampled Systems and the Effects of Clock Phase Noise and Jitter (Rev. 0)PDF291 點(diǎn)擊下載
    AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev. 0)PDF130 點(diǎn)擊下載
    AN-939: Super-Nyquist Operation of the AD9912 Yields a High RF Output Signal (Rev. 0)PDF221 點(diǎn)擊下載
    AN-837: DDS-Based Clock Jitter Performance vs. DAC Reconstruction Filter Performance (Rev. 0)PDF313 點(diǎn)擊下載
    AN-823: Direct Digital Synthesizers in Clocking Applications Time (Rev. 0)PDF115 點(diǎn)擊下載
    AN-927: Determining if a Spur is Related to the DDS/DAC or to Some Other Source (For Example, Switching Supplies) (Rev. 0)PDF170 點(diǎn)擊下載

    應(yīng)用案例更多案例

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    ATMEGA64A-AUATTINY2313V-10PUAD7400AADN4690E
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