MC74AC377

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?Octal D Flip-Flop with Clock Enable

制造商：ON

中文數(shù)據(jù)手冊

產(chǎn)品信息

The MC74AC377/74ACT377 has eight edge-triggered, D-type flip-flops withindividual D inputs and Q outputs. The common buffered Clock (CP) input loadsall flip-flops simultaneously, when the Clock Enable (CE) is LOW.
The register is fully edge-triggered. The state of each D input, one setup timebefore the LOW-to-HIGH clock transition, is transferred to the corresponding flipflop's Q output. The CE input must be stable only one setup time prior to theLOW-to-HIGH clock transition for predictable operation.

Ideal for Addressable Register Applications
Clock Enable for Address and Data Synchronization Applications
Eight Edge-Triggered D Flip-Flops
Buffered Common Clock
Outputs Source/Sink 24 mA
See MC74AC273 for Master Reset Version
See MC74AC373 for Transparent Latch Version
See MC74AC374 for 3-State Version
ACT377 Has TTL Compatible Inputs
Pb-Free Packages are Available

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型號	制造商	描述	購買
MC74AC377DWG	ON	MC74AC377/74ACT377 具有八個邊觸發(fā) D 型觸發(fā)器，帶單獨(dú)的 D 輸入和 Q 輸出。公共緩沖時鐘 (CP) 輸入將在時鐘啟用 (CE) 為低電平時同時加載所有觸發(fā)器。寄存器完全為邊觸發(fā)。低-高時鐘轉(zhuǎn)換之前每個 D 輸入的狀態(tài)、一個設(shè)置時間傳輸?shù)较鄳?yīng)觸發(fā)器的 Q 輸出。CE 輸入必須在低電平-高電平時鐘轉(zhuǎn)換之前穩(wěn)定一個設(shè)置時段，才能實(shí)現(xiàn)可預(yù)測運(yùn)行。	立即購買
MC74AC377DWR2G	ON		立即購買
MC74AC377DTG	ON		立即購買
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技術(shù)資料

標(biāo)題	類型	大小（KB）	下載
Octal D Flip Flop with Clock Enable	PDF	96	點(diǎn)擊下載
IBIS Model for MC74AC377DW	UNKNOW	9	點(diǎn)擊下載
IBIS Model for MC74AC377_33DW	UNKNOW	9	點(diǎn)擊下載
TSSOP-20 WB	PDF	38	點(diǎn)擊下載
SOIC-20 WB	PDF	35	點(diǎn)擊下載

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