
描述
在雙電壓的體系結(jié)構(gòu),電源的協(xié)調(diào)管理是必要的,以避免潛在的問題和確保可靠的性能。電源設(shè)計(jì)人員必須考慮的時(shí)序和電壓在上電和斷電操作內(nèi)核和I / O電源電壓之間的差異。測(cè)序是指在順序,定時(shí)和微分,其中兩個(gè)電源電壓被加電并下來。設(shè)計(jì)時(shí)沒有正確的順序的系統(tǒng)可能存在風(fēng)險(xiǎn)的兩類故障。第一這些代表的雙電壓設(shè)備的長(zhǎng)期可靠性的威脅,而第二個(gè)是更立即,具有破壞性的接口電路中的處理器或系統(tǒng)設(shè)備諸如可能性存儲(chǔ)器,邏輯或數(shù)據(jù)轉(zhuǎn)換器集成電路。不當(dāng)電源排序的另一個(gè)潛在的問題是總線爭(zhēng)用。
總線爭(zhēng)用條件時(shí),所述處理器和其它設(shè)備都試圖功率期間控制一個(gè)雙向總線了。總線爭(zhēng)也可能會(huì)影響I / O的可靠性。電源設(shè)計(jì)人員必須檢查的要求對(duì)于總線爭(zhēng)用單個(gè)設(shè)備。上電順序?yàn)镺MAP -L138 , TMS320C6742 , TMS320C6746 , TMS320C6748和有在下面的電源要求表所示。沒有特定的電壓上升速度是必需的任何的耗材只要3.3 V電壓軌從來沒有超過2 V.超過1.8 V電壓軌為了降低所述處理器核心的功率消耗,動(dòng)態(tài)電壓和頻率調(diào)整( DVFS)用在參考設(shè)計(jì)。 DVFS是同時(shí)使用主動(dòng)電源管理技術(shù)處理正在進(jìn)行中的系統(tǒng)級(jí)芯片(SoC)的相匹配的工作頻率硬件到活動(dòng)應(yīng)用場(chǎng)景的性能要求。每當(dāng)時(shí)鐘頻率被降低,工作電壓也降低,實(shí)現(xiàn)節(jié)能。在參考設(shè)計(jì)中,TPS62353用于可擴(kuò)展其輸出電壓。
C4532X5R1A476M電路圖
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