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    首頁產(chǎn)品索引ADRF6604

    ADRF6604

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    1200 MHz 至 3600 MHz 接收混頻器,集成小數(shù)N分頻PLL和VCO

    制造商:ADI/AD

    中文數(shù)據(jù)手冊

    產(chǎn)品信息

    優(yōu)勢和特點

      集成小數(shù)N分頻PLL的接收混頻器

      RF輸入頻率范圍: 1,200 MHz至3,600 MHz

      內(nèi)部LO頻率范圍: 2,500 MHz至2,900 MHz

      輸入P1dB: 14.5 dBm

      輸入IP3: 27.5 dBm

      通過外部引腳優(yōu)化IIP3

      SSB噪聲系數(shù) IP3SET引腳斷開: 14.3 dBIP3SET引腳接3.3 V電壓: 15.5 dB

      電壓轉(zhuǎn)換增益: 6.8 dB

      200 Ω IF輸出匹配阻抗

      IF 3 dB帶寬: 500 MHz

      可通過三線式SPI接口進行編程

      40引腳、6 mm × 6 mm LFCSP

    產(chǎn)品詳情

    ADRF6604是一款高動態(tài)范圍有源混頻器,集成鎖相環(huán)(PLL)和壓控振蕩器(VCO)。PLL/頻率合成器利用小數(shù)N分頻PLL產(chǎn)生 fLO 輸入,供給混頻器。參考輸入可以進行分頻或倍頻,然后施加于PLL鑒頻鑒相器(PFD)。

    PLL支持12 MHz至160 MHz范圍內(nèi)的輸入?yún)⒖碱l率。PFD輸出控制一個電荷泵,其輸出驅(qū)動一個片外環(huán)路濾波器。

    然后,環(huán)路濾波器輸出施加于一個集成式VCO。VCO輸出(2 ×fLO再施加于一個LO分頻器和一個可編程PLL分頻器??删幊蘌LL分頻器由一個Σ-Δ調(diào)制器(SDM)進行控制。SDM的模數(shù)可以在1至2047范圍內(nèi)編程。

    有源混頻器可將單端50 Ω RF輸入轉(zhuǎn)換為200 Ω差分IF輸出。IF輸出的工作頻率最高可達500 MHz。

    ADRF6604采用先進的硅鍺BiCMOS工藝制造。采用符合RoHS標準的40引腳、6 mm x 6 mm LFCSP封裝,帶裸露焊盤。額定溫度范圍為-40 ℃至+85 ℃。

    應(yīng)用

      蜂窩基站

    電路圖、引腳圖和封裝圖

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    ADRF6604ACPZ-R7-- 立即購買

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    ADC78H89ADSP-BF592KCPZ-2AD8615ADC141S626
    AT25256B-SSHLADG5404FAD9161ADM6819
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