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制造商：ADI/AD
優(yōu)勢和特點
主要輸入電壓范圍：2.3 V至5.5 V
兩個1200 mA降壓調(diào)節(jié)器和一個300 mA LDO
24引腳4 mm × 4 mm LFCSP封裝
調(diào)節(jié)器精度： ±1.8%
工廠編程設(shè)置或外部可調(diào)的VOUTx
3 MHz降壓工作，支持強制PWM模式和自動PWM/PSM模式
BUCK1/BUCK2：輸出電壓范圍0.8 V至3.8 V
LDO：輸出電壓范圍0.8 V至4.75 V
LDO：低輸入電源電壓范圍1.7 V至5.5 V
LDO：高PSRR、低輸出噪聲
產(chǎn)品詳情
ADP5024在一個24引腳4 mm × 4 mm小型LFCSP封裝中集成了兩個高性能降壓調(diào)節(jié)器和一個低壓差調(diào)節(jié)器(LDO)，可滿足嚴(yán)苛的性能和電路板空間要求。
降壓調(diào)節(jié)器的高開關(guān)頻率支持小型多層外部器件，并使電路板空間降至最小。當(dāng)MODE引腳設(shè)置為高電平時，降壓調(diào)節(jié)器以強制PWM模式工作。當(dāng)MODE引腳設(shè)置為低電平時，如果負(fù)載電流高于預(yù)定義閾值，則降壓調(diào)節(jié)器以PWM模式工作；當(dāng)負(fù)載電流降至預(yù)定義閾值以下時，調(diào)節(jié)器以省電模式(PSM)工作，以便改善輕負(fù)載效率。
為降低輸入電容要求，兩個降壓器以錯相工作。LDO的低靜態(tài)電流、低壓差和寬輸入電壓范圍可延長便攜式設(shè)備的電池使用時間。在頻率高達(dá)10 kHz時，ADP5024 LDO能保持60 dB以上的電源抑制性能，而所需的電壓裕量則很低。
ADP5024中的調(diào)節(jié)器通過專用使能引腳激活。可調(diào)版本的默認(rèn)輸出電壓可以在外部設(shè)置，固定電壓版本的默認(rèn)輸出電壓則可在工廠編程設(shè)置；預(yù)設(shè)值范圍廣泛。
應(yīng)用
適用于處理器、ASIC、FPGA和RF芯片組的電源
便攜式儀器儀表和醫(yī)療設(shè)備
空間受限器件
ADP5024電路圖
| 型號 | 制造商 | 描述 | 購買 |
|---|---|---|---|
| ADP5024ACPZ-R7 | - | - | 立即購買 |
| ADP5024ACPZ-R2 | - | - | 立即購買 |
| ADP5024ACPZ-2-R7 | - | - | 立即購買 |
| ADP5024ACPZ-1-R7 | - | - | 立即購買 |
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| ADUM6210 | AD841 | AD825 | ADSP-21486 |
| AC1387 | ADG1209 | ADG3231 | AT90CAN64 |
| AD5378 | ADM6713 | ADA4851-1 | AD8671ARMZ |
| ADV216 | ADM709 | AD9371 | ADM488 |
| ADUM5010 | ADL5721 | ADXL312 | ADVFC32 |
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