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    首頁產(chǎn)品索引AD9523-1

    AD9523-1

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    低抖動時鐘發(fā)生器,提供14路LVPECL/LVDS/HSTL輸出或29路LVCMOS輸出

    制造商:ADI/AD

    產(chǎn)品信息

    優(yōu)勢和特點

      輸出頻率范圍:<1 MHz至1 GHz

      啟動頻率精度:<±100 ppm(由VCXO參考精度決定)

      零延遲操作輸入至輸出邊沿時序:<150 ps

      兩個VCO分頻器

      14 路輸出:可配置為LVPECL、LVDS、HSTL和LVCMOS

      14 個具有零抖動可調(diào)延遲的專用輸出分頻器

      可調(diào)延遲:63個分辨率步進,步長等于VCO輸出分頻器的?周期

      輸出間偏斜:<50 ps

      針對奇數(shù)分頻器設置提供占空比校正

      上電時所有輸出自動同步

      絕對輸出抖動:<150 fs(122.88 MHz時) 積分范圍:12 kHz至20 MHz

      欲了解更多特性,請參考數(shù)據(jù)手冊

    產(chǎn)品詳情

    AD9523-1提供低功耗、多路輸出時鐘分配功能,具有低抖動性能,還配有片內(nèi)PLL、VCO和兩個VCO分頻器。片內(nèi)VCO的調(diào)諧頻率范圍為2.94 GHz至3.1 GHz。

    AD9523-1旨在滿足長期演進(LTE)和多載波GSM基站設計的時鐘要求。它依靠外部VCXO清除參考抖動,以滿足嚴格的低相位噪聲要求,從而獲得可接受的數(shù)據(jù)轉(zhuǎn)換器信噪比(SNR)性能。

    輸入接收器、振蕩器和零延遲接收器支持單端和差分兩種操作。當連接到恢復的系統(tǒng)參考時鐘和VCXO時,器件產(chǎn)生1 MHz至1 GHz范圍內(nèi)的14路低噪聲輸出,以及一路來自輸入PLL (PLL1)的專用緩沖輸出。一路時鐘輸出相對于另一路時鐘輸出的頻率和相位可通過分頻器相位選擇功能改變,該功能用作無抖動的時序粗調(diào),其調(diào)整增量相當于VCO輸出信號的半個周期。

    通過串行接口可以對封裝內(nèi)EEPROM進行編程,以存儲用于上電和芯片復位的用戶定義寄存器設置。

    應用-LTE 和多載波GSM基站-無線和寬帶基礎設施-醫(yī)療儀器-為高速ADC、DAC、DDS、DDC、DUC、MxFE提供時鐘-低抖動、低相位噪聲時鐘分配-SONET、10Ge、10G FC和其它10 Gbps協(xié)議的時鐘產(chǎn)生和轉(zhuǎn)換-前向糾錯(G.710)-高性能無線收發(fā)器-自動測試設備(ATE)和高性能儀器儀表

    電路圖、引腳圖和封裝圖

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    AD9523-1BCPZ-REEL7-- 立即購買
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    技術資料

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    AN-1066: Power Supply Considerations for AD9523, AD9524, and AD9523-1 Low Noise Clocks (Rev. A)PDF432 點擊下載
    AN-1066: 低噪聲時鐘AD9523、AD9524和AD9523-1的電源考慮 (Rev. 0)PDF719 點擊下載
    UG-182:AD9523-1評估板用戶指南PDF711 點擊下載
    UG-182: Evaluation Board User Guide for AD9523-1 Clock GeneratorPDF711 點擊下載

    應用案例更多案例

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