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數(shù)字電路觸發(fā)器電路數(shù)字邏輯電路

D觸發(fā)器結(jié)構(gòu)的五分頻器邏輯電路

D觸發(fā)器結(jié)構(gòu)的五分頻器邏輯電路
提問者：naiztycheng 地點：- 瀏覽次數(shù)：10258 提問時間：12-13 03:16
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chm7 12-16 02:49



D觸發(fā)器結(jié)構(gòu)的五分頻器邏輯電路由3 個D 觸發(fā)器和少量邏輯門構(gòu)成， 采用了同步工作模式， 其原理是由吞脈沖計數(shù)原理產(chǎn)生2 個占空比不同的五分頻信號A 和B, 然后對時鐘信號CLK, A 和B 進行邏輯運算得到占空比為50% 的五分頻信號CLK/ 5, 其計數(shù)過程如表1 所示， 從表1 的計數(shù)過程可知， 分頻后的時鐘CLK/ 5 的周期是輸入時鐘CLK 的5 倍， 由此實現(xiàn)了五分頻并且其占空比為50% .



　　




D觸發(fā)器結(jié)構(gòu)的五分頻器邏輯電路




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