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    首頁(yè)產(chǎn)品索引ADCLK925

    ADCLK925

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    超快型SiGe ECL時(shí)鐘/數(shù)據(jù)緩沖器

    制造商：ADI/AD

    中文數(shù)據(jù)手冊(cè)

    產(chǎn)品信息

    優(yōu)勢(shì)和特點(diǎn)

      傳播延遲：95 ps

      反轉(zhuǎn)率：7.5 GHz

      典型輸出上升/下降：60 ps

      隨機(jī)抖動(dòng)(RJ)：60 fs

      兩個(gè)輸入引腳上均有片內(nèi)端電極

      擴(kuò)展工業(yè)溫度范圍：?40°C至+125°C

      電源：2.5 V至3.3 V(VCC – VEE)

    產(chǎn)品詳情

    .line { color: #ff0000;}ADCLK905（單輸入/單輸出）、ADCLK907（雙通道單輸入/單輸出）和ADCLK925（單輸入/雙輸出）為超高速時(shí)鐘/數(shù)據(jù)緩沖器，采用ADI公司專有的XFCB3硅鍺(SiGe)雙極性工藝制造。

    ADCLK905/ADCLK907/ADCLK925內(nèi)置全擺幅射極耦合邏輯（ECL）輸出驅(qū)動(dòng)器。對(duì)于PECL（正ECL）工作模式，將VCC偏置至正電源，將VEE 偏置至接地。對(duì)于NECL(負(fù)ECL)工作，VCC偏置至接地，VEE 偏置到負(fù)電源。

    緩沖器具備95 ps的傳播延遲、7.5 GHz的觸發(fā)率、10 Gbps的數(shù)據(jù)速率以及60 fs的隨機(jī)抖動(dòng)(RJ)。

    輸入含有100 Ω的中心抽頭片內(nèi)端接電阻。提供VREF引腳用于偏置交流耦合輸入。

    ECL輸出級(jí)旨在從各端將800 mW直接驅(qū)動(dòng)至端接于VCC ? 2 V的50 Ω負(fù)載，從而獲得1.6 V的總差分輸出擺幅

    ADCLK905/ADCLK907/ADCLK925提供16引腳LFCSP封裝。

    應(yīng)用

       時(shí)鐘和數(shù)據(jù)信號(hào)恢復(fù)和電平轉(zhuǎn)換

      自動(dòng)測(cè)試設(shè)備(ATE)

      高速儀器儀表

      高速線路接收機(jī)

      閾值檢測(cè)

      轉(zhuǎn)換器時(shí)鐘

    電路圖、引腳圖和封裝圖

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    技術(shù)資料

    標(biāo)題類型大?。↘B）下載
    AN-501: Aperture Uncertainty and ADC System Performance (Rev. A)PDF227 點(diǎn)擊下載
    AN-756: Sampled Systems and the Effects of Clock Phase Noise and Jitter (Rev. 0)PDF291 點(diǎn)擊下載
    AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev. 0)PDF130 點(diǎn)擊下載
    AN-939: Super-Nyquist Operation of the AD9912 Yields a High RF Output Signal (Rev. 0)PDF221 點(diǎn)擊下載
    AN-837: DDS-Based Clock Jitter Performance vs. DAC Reconstruction Filter Performance (Rev. 0)PDF313 點(diǎn)擊下載
    AN-823: Direct Digital Synthesizers in Clocking Applications Time (Rev. 0)PDF115 點(diǎn)擊下載
    AN-927: Determining if a Spur is Related to the DDS/DAC or to Some Other Source (For Example, Switching Supplies) (Rev. 0)PDF170 點(diǎn)擊下載
    AN-769: 基于AD9540產(chǎn)生多時(shí)鐘輸出 (Rev. 0)PDF2048 點(diǎn)擊下載

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